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再將1個BANKGROUP區(qū)域分成4個BANK小區(qū)域，分別命名為BANK0、BANK1、BANK2、BANK3。然后我們挑出2根地址線（還剩余17根）命名為BA0和BA1，為4個小BANK進行地址編碼。
此時，我們將DDR內(nèi)存顆粒劃分成了2個BANK GROUP，每個BANKGROUP又分成了4個BANK，共8個BANK區(qū)域，分配了3根地址線，分別命名為BG0，BA0，BA1。然后我們還剩余17根信號線，每個BANK又該怎么設(shè)計呢？這時候，就要用到分時復(fù)用的設(shè)計理念了。
剩下的17根線，次用來表示行地址，第二次用來表示列地址?，F(xiàn)在修改為傳輸2次地址，在傳輸1次數(shù)據(jù)，尋址范圍多被擴展為2GB。雖然數(shù)據(jù)傳輸速度降低了一半，但是存儲空間被擴展了很多倍。這就是改善空間。
所以，剩下的17根地址線，留1根用來表示傳輸?shù)刂肥欠駷樾械刂贰?/p>
在第1次傳輸時，行地址選擇使能，剩下16根地址線，可以表示行地址范圍，可以輕松算出行地址范圍為2^16=65536個=64K個。
在第2次傳輸時，行地址選擇禁用，剩下16根地址線，留10根列地址線表示列地址范圍，可以輕松表示的列地址范圍為2^10=1024個=1K個，剩下6根用來表示讀寫狀態(tài)/刷新狀態(tài)/行使能、等等復(fù)用功能。
這樣，我們可以把1個BANK劃分成67108864個=64M個地址編號。如下所示
所以1個BANK可以分成65536行，每行1024列，每個存儲單元16bit。
所以1個BANK可以分成65536行，每行1024列，每個存儲單元16bit。
每行可以存儲1024*16bit=2048bit=2KB。每行的存儲的容量，稱為Page Size。
單個BANK共65536行，所以每個BANK存儲容量為65536*2KB=128MB。
單個BANK GROUP共4個BANK，每個BANK GROUP存儲容量為512MB。
單個DDR4芯片有2個BANK GROUP，故單個DDR4芯片的存儲容量為1024MB=1GB。
至此，20根地址線和16根數(shù)據(jù)線全部分配完成，我們用正向設(shè)計的思維方式，為大家講解了DDR4的存儲原理以及接口定義和尋址方式。
但是細心的同學(xué)發(fā)現(xiàn)一個問題，對于每一個bank，按照正常的10位數(shù)據(jù)，那么col應(yīng)該是1024，而現(xiàn)在是128，是什么原因呢？
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北京淼森波信息技術(shù)有限公司（MISENBO）成立于2015年，是一家技術(shù)服務(wù)型公司，即為中小型、初創(chuàng)型企業(yè)提供硬件開發(fā)配套服務(wù)和硬件測試服務(wù)。主要業(yè)務(wù)有：高速電路測試服務(wù)和儀器儀表租售業(yè)務(wù)。高速電路測試服務(wù)項目有：① SI信號完整性測試，主要內(nèi)容是電源上電時序、復(fù)位、時鐘、I2C、SPI、Flash、DDR、JTAG接口、CPLD接口測試、URAT測試、網(wǎng)口測試、USB2.0/USB3.0測試、MIPI測試、HDMI測試、及板卡上其它芯...